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DS36277TMX/NOPB TI Chips Modulo dominante Trasmettitore multipunto

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DS36277TMX/NOPB TI Chips Modulo dominante Trasmettitore multipunto

Marchio:	TI Chips
Numero di modello:	DS36277TMX/NOPB
MOQ:	2500
Dettagli dell'imballaggio:	2500 pezzi/bobina
Termini di pagamento:	T/T

Informazioni dettagliate

Descrizione del prodotto

Informazioni dettagliate

Luogo di origine:

Documento:

modello:

DS36277TMX/NOPB

Nome del prodotto:

Chip TI

Tipo:

SMD/SMT

Velocità dati:

20 mb/s

Incapsulamento:

Bobina

Tensione di alimentazione operativa:

Capacità di alimentazione:

1000000

Evidenziare:

DS36277TMX/NOPB

Chips TI DS36277

Trasmettitore multipunto in modalità dominante

Descrizione del prodotto

TI Chips DS36277TMX/NOPB Modulo dominante Trasmettitore multipunto

Caratteristiche
Ricevitore FAILSAFE, RO = ALTO per:
OPEN Input
Input terminati
Input abbreviati
Ottimale per l'uso nelle interfacce SAE J1708
Compatibile con gli standard di interfaccia popolari:
TIA/EIA-485 e TIA/EIA-422-A
Raccomandazione V del CCITT.11
Trasmettitore bidirezionale
Progettato per la trasmissione multipunto
Ampia gamma di modalità comune del bus
(−7V a +12V)
Disponibile nei pacchetti PDIP e SOIC

Descrizione
Il trasmettitore multipunto in modalità dominante DS36277 è progettato per l'uso su bus differenziali bidirezionali.È ottimale per l'uso su interfacce che utilizzano lo standard elettrico Society of Automotive Engineers (SAE) J1708.
Il dispositivo è simile agli trasmettitori standard TIA/EIA-485, ma differisce nello schema di abilitazione.o Disabled (OFF)Quando il conducente è attivo, la modalità dominante è bassa, al contrario, quando il conducente è disabilitato, il bus viene tirato in alto da resistenze di bias esterne.
Il ricevitore fornisce una funzione FAILSAFE che garantisce uno stato di uscita noto quando l'interfaccia è nelle seguenti condizioni: linea galleggiante, linea inattiva (senza driver attivi),e condizioni di guasto della linea (aperto o corto)L'uscita del ricevitore è alta per le seguenti condizioni: ingressi aperti, ingressi terminati (50Ω) o ingressi corti.FAILSAFE è una caratteristica molto desiderabile quando i ricevitori sono utilizzati con controllori asincroni come gli UART.

Diagramma di connessione e logica

Tag:

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