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LMK1D1204RGTR TI Chips LMK1D120x Low Additive Jitter LVDS Buffer Frequenza di uscita fino a 2GHz.

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LMK1D1204RGTR TI Chips LMK1D120x Low Additive Jitter LVDS Buffer Frequenza di uscita fino a 2GHz.

Marchio:	TI Chips
Numero di modello:	LMK1D1204RGTR
MOQ:	3000
Dettagli dell'imballaggio:	3000 pezzi/bobina
Termini di pagamento:	T/T

Informazioni dettagliate

Descrizione del prodotto

Informazioni dettagliate

Luogo di origine:

Documento:

modello:

LMK1D1204RGTR

Nome del prodotto:

Chip TI

Tipo:

SMD/SMT

Corrente di alimentazione operativa:

60 Ma

Incapsulamento:

Bobina

Frequenza dell'uscita massima:

2 GHz

Capacità di alimentazione:

1000000

Evidenziare:

LMK1D1204RGTR

LMK1D1204 TI Chips

Buffer LVDS da 2GHz

Descrizione del prodotto

TI Chips LMK1D1204RGTR LMK1D120x Low Additive Jitter LVDS Buffer Frequenza di uscita fino a 2GHz.

Caratteristiche

• Famiglia di buffer di clock LVDS ad alte prestazioni con 2

ingressi e 4 (2:4) o 8 (2:8) uscite.

• Frequenza di uscita fino a 2GHz.

• Tensione di alimentazione: da 1,71V a 3,465V

• Basso jitter additivo:< massimo 60fs RMS in 12kHz

a 20MHz a 156,25MHz

– Rumore di fase a bassissimo livello: –164dBc/Hz

(tipico)

• Ritardo di propagazione molto basso:< 575ps massimo

• Skew di uscita: 20ps massimo

• Gli ingressi universali accettano ingressi LVDS, LVPECL, LVCMOS,

LP-HCSL, HCSL e CML

• Tensione di riferimento LVDS, VAC_REF, disponibile per

ingressi accoppiati capacitivamente

• Intervallo di temperatura industriale: –40°C a 105°C

• Pacchetti disponibili:

– LMK1D1204: VQFN a 16 pin da 3 mm × 3 mm (RGT)

– LMK1D1208: VQFN a 28 pin da 5 mm × 5 mm

(RHD)

Applicazioni

• Telecomunicazioni e networking

• Imaging medico

• Test e misurazione

• Infrastruttura wireless

• Pro audio, video e segnaletica

Descrizione

Il buffer di clock LMK1D120x distribuisce uno dei due

ingressi di clock selezionabili (IN0 e IN1) a 4 o 8 coppie

di uscite di clock differenziali LVDS (OUT0 a

OUT7) con skew minimo per la distribuzione del clock. La

famiglia LMK1D12xx può accettare due sorgenti di clock in

un multiplexer di ingresso. Gli ingressi possono essere LVDS,

LVPECL, LP-HCSL, HCSL, CML o LVCMOS.

Il LMK1D12xx è specificamente progettato per pilotare

linee di trasmissione da 50Ω. Nel caso di pilotaggio degli ingressi

in modalità single-ended, la tensione di bias appropriata come

mostrato nella Figura 8-6 deve essere applicata al pin

di ingresso negativo non utilizzato.

Il pin IN_SEL seleziona l'ingresso che viene instradato alle

uscite. Se questo pin viene lasciato aperto, il pin disabilita

le uscite (logica bassa). Il componente supporta una funzione di

fail-safe. Il dispositivo incorpora inoltre un'isteresi di ingresso

che impedisce oscillazioni casuali delle uscite in assenza di un

segnale di ingresso.

Il dispositivo opera in un ambiente di alimentazione da 1,8V o 2,5V o 3,3V

ed è caratterizzato da –40°C

a 105°C (temperatura ambiente). La variante del pacchetto

LMK1D12xx è mostrata nella tabella sottostante:

Tag:

la gestione dell'energia

ti autista

regolatore di velocità

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